Transceptor de bus Transceptor de bus SN74LVTH245ADW, LVT 8 bits No Inversión SOIC 20 pines
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LVT
Función Lógica
Transceptor de bus
Número de Elementos por Chip
1
Número de Canales por Chip
8
Polarity
No Inversión
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SOIC W
Conteo de Pines
20
Input Level
LVTTL
Nivel de Salida
LVTTL
Corriente Máxima de Salida de Alto Nivel
-32mA
Corriente Máxima de Salida de Bajo Nivel
64mA
Maximum Propagation Delay Time @ Maximum CL
2.3 ns @ 3.3 V
Máxima Temperatura de Funcionamiento
+85 °C.
Propagation Delay Test Condition
50pF
Longitud
12.8mm
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Altura
2.35mm
Profundidad
7.52mm
Temperatura de Funcionamiento Mínima
-40 ºC
Dimensiones del Cuerpo
12.8 x 7.52 x 2.35mm
Tensión de Alimentación de Funcionamiento Mínima
2.7 V
Datos del producto
Familia 74LVTH, Texas Instruments
Lógica BiCMOS de baja tensión y alta velocidad
Tensión de funcionamiento: 2,7 a 3,6
La función de retención de bus en las entradas elimina la necesidad de recurrir a resistencias de pull-up de alto valor
Compatibilidad: entrada LVTTL/TTL, salida LVTTL
74LVTH Family
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P.O.A.
25
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Texas InstrumentsFamilia Lógica
LVT
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Transceptor de bus
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1
Número de Canales por Chip
8
Polarity
No Inversión
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SOIC W
Conteo de Pines
20
Input Level
LVTTL
Nivel de Salida
LVTTL
Corriente Máxima de Salida de Alto Nivel
-32mA
Corriente Máxima de Salida de Bajo Nivel
64mA
Maximum Propagation Delay Time @ Maximum CL
2.3 ns @ 3.3 V
Máxima Temperatura de Funcionamiento
+85 °C.
Propagation Delay Test Condition
50pF
Longitud
12.8mm
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Altura
2.35mm
Profundidad
7.52mm
Temperatura de Funcionamiento Mínima
-40 ºC
Dimensiones del Cuerpo
12.8 x 7.52 x 2.35mm
Tensión de Alimentación de Funcionamiento Mínima
2.7 V
Datos del producto
Familia 74LVTH, Texas Instruments
Lógica BiCMOS de baja tensión y alta velocidad
Tensión de funcionamiento: 2,7 a 3,6
La función de retención de bus en las entradas elimina la necesidad de recurrir a resistencias de pull-up de alto valor
Compatibilidad: entrada LVTTL/TTL, salida LVTTL
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