Latch SN74LVC573APWR, Transparente Tipo D 3 estados TSSOP 20 pines 8bit
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LVC
Modo de Enclavamiento
Transparent
Elemento de Enclavamiento
Tipo D
Número de Bits
8bit
Tipo de salida
3 State
Polarity
No Inversión
Tipo de Montaje
Surface Mount
Tipo de Encapsulado
TSSOP-16
Número de pines
20
Dimensiones
6.5 x 4.4 x 1.15mm
Altura
1.15mm
Largo
6.5mm
Máxima Temperatura de Funcionamiento
+85 °C.
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Anchura
4.4mm
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Mínima Temperatura de Funcionamiento
–40 °C
Datos del producto
Registros y biestables de la familia 74LVC, Texas Instruments
Gama de registros y biestables de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments. La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a +3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
La protección contra ESD excede JESD 22
74LVC Family
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P.O.A.
Each (Supplied on a Reel) (Sin IVA)
Empaque de Producción (Rollo)
10
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LVC
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Transparent
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Tipo D
Número de Bits
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Tipo de salida
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Polarity
No Inversión
Tipo de Montaje
Surface Mount
Tipo de Encapsulado
TSSOP-16
Número de pines
20
Dimensiones
6.5 x 4.4 x 1.15mm
Altura
1.15mm
Largo
6.5mm
Máxima Temperatura de Funcionamiento
+85 °C.
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Anchura
4.4mm
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Mínima Temperatura de Funcionamiento
–40 °C
Datos del producto
Registros y biestables de la familia 74LVC, Texas Instruments
Gama de registros y biestables de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments. La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a +3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
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