Latch SN74LVC573ADW, Transparente Tipo D 3 estados SOIC 20 pines 8bit
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LVC
Modo de Enclavamiento
Transparente
Elemento de Enclavamiento
D Type
Número de Bits
8bit
Output Type
3 State
Polarity
No Inversión
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SOIC W
Conteo de Pines
20
Dimensiones del Cuerpo
12.8 x 7.52 x 2.35mm
Altura
2.35mm
Longitud
12.8mm
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Máxima Temperatura de Funcionamiento
+85 °C.
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Profundidad
7.52mm
Temperatura de Funcionamiento Mínima
-40 ºC
Datos del producto
Registros y biestables de la familia 74LVC, Texas Instruments
Gama de registros y biestables de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments. La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a +3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
La protección contra ESD excede JESD 22
74LVC Family
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Número de Bits
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Output Type
3 State
Polarity
No Inversión
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SOIC W
Conteo de Pines
20
Dimensiones del Cuerpo
12.8 x 7.52 x 2.35mm
Altura
2.35mm
Longitud
12.8mm
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Máxima Temperatura de Funcionamiento
+85 °C.
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Profundidad
7.52mm
Temperatura de Funcionamiento Mínima
-40 ºC
Datos del producto
Registros y biestables de la familia 74LVC, Texas Instruments
Gama de registros y biestables de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments. La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a +3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
La protección contra ESD excede JESD 22
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