Búfer, SN74LVC1G34DCKT, LVC, No Inversión SC-70 5 pines No

Código de producto RS: 662-8783PMarca: Texas InstrumentsNúmero de parte de fabricante: SN74LVC1G34DCKT
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Documentos Técnicos

Especificaciones

Familia Lógica

LVC

Función Lógica

Buffer

Number of Channels

1

Entrada de disparador Schmitt

No

Tipo de entrada

Single Ended

Polarity

No Inversión

Tipo de montaje

Surface Mount

Tipo de Encapsulado

SC-70, SOT

Conteo de Pines

5

Corriente Máxima de Salida de Alto Nivel

-32mA

Corriente Máxima de Salida de Bajo Nivel

32mA

Maximum Propagation Delay Time @ Maximum CL

4.1 ns @ 3.3 V

Dimensiones del Cuerpo

2 x 1.25 x 0.9mm

Tensión de Alimentación Máxima de Funcionamiento

5.5 V

Temperatura Mínima de Operación

-40 ºC

Altura

0.9mm

Propagation Delay Test Condition

50pF

Temperatura Máxima de Operación

+85 °C.

Longitud

2mm

Ancho

1.25mm

Tensión de Alimentación de Funcionamiento Mínima

1.65 V

Datos del producto

Familia 74LVC1G, Texas instruments

Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22

74LVC Family

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Familia Lógica

LVC

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No

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Single Ended

Polarity

No Inversión

Tipo de montaje

Surface Mount

Tipo de Encapsulado

SC-70, SOT

Conteo de Pines

5

Corriente Máxima de Salida de Alto Nivel

-32mA

Corriente Máxima de Salida de Bajo Nivel

32mA

Maximum Propagation Delay Time @ Maximum CL

4.1 ns @ 3.3 V

Dimensiones del Cuerpo

2 x 1.25 x 0.9mm

Tensión de Alimentación Máxima de Funcionamiento

5.5 V

Temperatura Mínima de Operación

-40 ºC

Altura

0.9mm

Propagation Delay Test Condition

50pF

Temperatura Máxima de Operación

+85 °C.

Longitud

2mm

Ancho

1.25mm

Tensión de Alimentación de Funcionamiento Mínima

1.65 V

Datos del producto

Familia 74LVC1G, Texas instruments

Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22

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