O: Puerta lógica, SN74LVC1G32DBVT, LVC, 32mA SOT-23 5 pines 2 No
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFunción Lógica
OR
Tipo de montaje
Surface Mount
Número de Elementos
1
Number of Inputs per Gate
2
Entrada de disparador Schmitt
No
Tipo de Encapsulado
SOT-23-5
Conteo de Pines
5
Familia Lógica
LVC
Tensión de Alimentación Máxima de Funcionamiento
5.5 V
Corriente Máxima de Salida de Alto Nivel
-32mA
Maximum Propagation Delay Time @ Maximum CL
4 ns @ 5 V, 4.5 ns @ 3.3 V
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Corriente Máxima de Salida de Bajo Nivel
32mA
Temperatura Mínima de Operación
–40 °C
Altura
1.15mm
Dimensiones del Cuerpo
2.9 x 1.6 x 1.15mm
Propagation Delay Test Condition
50pF
Temperatura Máxima de Funcionamiento
+85 °C.
Largo
2.9mm
Profundidad
1.6mm
Datos del producto
Familia 74LVC1G, Texas instruments
Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22
74LVC Family
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P.O.A.
Each (Supplied on a Reel) (Sin IVA)
Empaque de Producción (Rollo)
5
P.O.A.
Each (Supplied on a Reel) (Sin IVA)
Volver a intentar más tarde
Empaque de Producción (Rollo)
5
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Especificaciones
Brand
Texas InstrumentsFunción Lógica
OR
Tipo de montaje
Surface Mount
Número de Elementos
1
Number of Inputs per Gate
2
Entrada de disparador Schmitt
No
Tipo de Encapsulado
SOT-23-5
Conteo de Pines
5
Familia Lógica
LVC
Tensión de Alimentación Máxima de Funcionamiento
5.5 V
Corriente Máxima de Salida de Alto Nivel
-32mA
Maximum Propagation Delay Time @ Maximum CL
4 ns @ 5 V, 4.5 ns @ 3.3 V
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Corriente Máxima de Salida de Bajo Nivel
32mA
Temperatura Mínima de Operación
–40 °C
Altura
1.15mm
Dimensiones del Cuerpo
2.9 x 1.6 x 1.15mm
Propagation Delay Test Condition
50pF
Temperatura Máxima de Funcionamiento
+85 °C.
Largo
2.9mm
Profundidad
1.6mm
Datos del producto
Familia 74LVC1G, Texas instruments
Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
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