Inversor CMOS, SN74LVC1G14YZVR, LVC, 32mA DSBGA 4 pines Sí

Código de producto RS: 660-7389PMarca: Texas InstrumentsNúmero de parte de fabricante: SN74LVC1G14YZVR
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Documentos Técnicos

Especificaciones

Función Lógica

Inverter

Tipo de entrada

Schmitt Trigger

Número de Elementos por Chip

1

Entrada de disparador Schmitt

Yes

Maximum Propagation Delay Time @ Maximum CL

5 ns @ 5 V, 5.5 ns @ 3.3 V

Corriente Máxima de Salida de Alto Nivel

-32mA

Corriente Máxima de Salida de Bajo Nivel

32mA

Tipo de montaje

Surface Mount

Tipo de Encapsulado

DSBGA

Conteo de Pines

4

Familia Lógica

LVC

Dimensiones del Cuerpo

0.9 x 0.9 x 0.35mm

Altura

0.35mm

Tensión de Alimentación Máxima de Funcionamiento

5.5 V

Mínima Temperatura de Funcionamiento

-40 ºC

Propagation Delay Test Condition

50pF

Temperatura máxima de funcionamiento

+85 °C.

Longitud

0.9mm

Ancho

0.9mm

Tensión de Alimentación de Funcionamiento Mínima

1.65 V

Datos del producto

Familia 74LVC1G, Texas instruments

Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22

74LVC Family

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Función Lógica

Inverter

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1

Entrada de disparador Schmitt

Yes

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5 ns @ 5 V, 5.5 ns @ 3.3 V

Corriente Máxima de Salida de Alto Nivel

-32mA

Corriente Máxima de Salida de Bajo Nivel

32mA

Tipo de montaje

Surface Mount

Tipo de Encapsulado

DSBGA

Conteo de Pines

4

Familia Lógica

LVC

Dimensiones del Cuerpo

0.9 x 0.9 x 0.35mm

Altura

0.35mm

Tensión de Alimentación Máxima de Funcionamiento

5.5 V

Mínima Temperatura de Funcionamiento

-40 ºC

Propagation Delay Test Condition

50pF

Temperatura máxima de funcionamiento

+85 °C.

Longitud

0.9mm

Ancho

0.9mm

Tensión de Alimentación de Funcionamiento Mínima

1.65 V

Datos del producto

Familia 74LVC1G, Texas instruments

Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22

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