Búfer, controlador de línea, SN74LVC1G125DCKR, LVC, 1 bits 3-State, No Inversión SC-70 5 pines
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LVC
Función Lógica
Búfer, controlador de línea
Número de Canales por Chip
1
Tipo de entrada
Single Ended
Output Type
3 State
Polarity
No Inversión
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SC-70, SOT
Conteo de Pines
5
Corriente Máxima de Salida de Alto Nivel
-32mA
Corriente Máxima de Salida de Bajo Nivel
32mA
Maximum Propagation Delay Time @ Maximum CL
4.5 ns @ 3.3 V
Dimensiones del Cuerpo
2 x 1.25 x 0.9mm
Tensión de Alimentación Máxima de Funcionamiento
5.5 V
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Propagation Delay Test Condition
50pF
Datos del producto
Familia 74LVC1G, Texas instruments
Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22
74LVC Family
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$ 300
Each (In a Pack of 25) (Sin IVA)
$ 357
Each (In a Pack of 25) (IVA Incluido)
25
$ 300
Each (In a Pack of 25) (Sin IVA)
$ 357
Each (In a Pack of 25) (IVA Incluido)
25
Comprar en grandes cantidades
Cantidad | Precio Unitario sin IVA | Por Pack |
---|---|---|
25 - 100 | $ 300 | $ 7.500 |
125 - 225 | $ 292 | $ 7.300 |
250 - 475 | $ 283 | $ 7.075 |
500 - 1225 | $ 276 | $ 6.900 |
1250+ | $ 269 | $ 6.725 |
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LVC
Función Lógica
Búfer, controlador de línea
Número de Canales por Chip
1
Tipo de entrada
Single Ended
Output Type
3 State
Polarity
No Inversión
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SC-70, SOT
Conteo de Pines
5
Corriente Máxima de Salida de Alto Nivel
-32mA
Corriente Máxima de Salida de Bajo Nivel
32mA
Maximum Propagation Delay Time @ Maximum CL
4.5 ns @ 3.3 V
Dimensiones del Cuerpo
2 x 1.25 x 0.9mm
Tensión de Alimentación Máxima de Funcionamiento
5.5 V
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Propagation Delay Test Condition
50pF
Datos del producto
Familia 74LVC1G, Texas instruments
Lógica CMOS de tensión baja
Encapsulado de puerta única
Tensión de funcionamiento: 1,65 a 5,5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento del cierre excede de 100 mA por JESD 78 Clase II
La protección contra ESD excede JESD 22